新手小白对串口的疑问

cobut · 发表于 2021-11-21 11:57:07

串口收发都是用的DR寄存器，读和写都是操作该寄存器的内容，如果同时收发不会存在数据覆盖吗？书上说DR包含TDR和RDR，可是ＤＲ明明只有8位啊，这点有点迷，还请大佬解答

eric2013 · 发表于 2021-11-21 12:04:28

这个时候要看参数手册，F4的发送和接收寄存器是独立的。
QQ截图20211121120323.png

eric2013 · 发表于 2021-11-21 12:06:38

实际操作上，根据你是读还是写，自动做硬件区分
QQ截图20211121120612.png

ghslfgkkl88 · 发表于 2021-11-21 12:20:28

其实就是两个独立的寄存器，一个寄存器负责发送，一个寄存器负责接收，你的读写操作由芯片自动分配到对应的寄存器，不会冲突。只不过这两个寄存器的名字和地址相同，DR寄存器就对应火车站，TDR就是火车站的入口，是你出发的地方；RDR就是火车的出口，你到达后的出口。但火车站的入口和出口都在火车站，对吧？

cobut · 发表于 2021-11-21 12:37:04

eric2013 发表于 2021-11-21 12:06
实际操作上，根据你是读还是写，自动做硬件区分

首先谢谢，然后收发的时候虽然都是对ＤＲ进行赋值，根据收发的不同，可以理解成对不同的存储区域进行操作么？

cobut · 发表于 2021-11-21 12:38:22

ghslfgkkl88 发表于 2021-11-21 12:20
其实就是两个独立的寄存器，一个寄存器负责发送，一个寄存器负责接收，你的读写操作由芯片自动分配到对应的 ...

这个确实容易理解些，谢谢

eric2013 · 发表于 2021-11-22 01:20:42

cobut 发表于 2021-11-21 12:37
首先谢谢，然后收发的时候虽然都是对ＤＲ进行赋值，根据收发的不同，可以理解成对不同的存储区域进行操作 ...

可以的，同一个地址两块单元，通过读写来区分不同单元。

旮旯旭 · 发表于 2021-11-22 09:36:56

ghslfgkkl88 发表于 2021-11-21 12:20
其实就是两个独立的寄存器，一个寄存器负责发送，一个寄存器负责接收，你的读写操作由芯片自动分配到对应的 ...

这解释非常不错

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