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[GPIO] i.MX RT的GPIO输出100MHz的波形,效果如何,补:找到了官方的测试数据

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发表于 2018-3-11 02:58:02 | 显示全部楼层 |阅读模式
高速IO在实际项目中的应用价值还是比较大的。

之前的时候测试F429的GPIO性能

QQ截图20180311025409.png




根据官方对RT1060的说明,将提供High-Speed GPIO, 也许有望能搞到200MHz。因为本身驱动SDRAM,都可以达到166MHz的最高时钟,就是不知道实际波形效果如何,后面专门测试下。


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发表于 2018-3-11 10:41:17 | 显示全部楼层
变形的有点离谱吧??
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 楼主| 发表于 2018-3-11 11:16:03 | 显示全部楼层
xieyang__ 发表于 2018-3-11 10:41
变形的有点离谱吧??

这个没关系的,最关键是波形的周期性和高低电平的辨识度。这个才36MHz的周期,像F429使用90MHz驱动SDRAM不也嗨嗨的。
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 楼主| 发表于 2018-3-11 11:48:00 | 显示全部楼层
找到了一个官方的测试。高低电平翻转

QQ截图20180311114733.png

QQ截图20180311114746.png
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发表于 2018-3-14 16:22:46 | 显示全部楼层
可不可 连接20M的高速AD 采集信号?
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 楼主| 发表于 2018-3-14 17:39:38 | 显示全部楼层
lcdz00 发表于 2018-3-14 16:22
可不可 连接20M的高速AD 采集信号?

可以,建议程序直接TCM里面跑,然后总线接口外接AD。
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发表于 2018-3-14 20:09:19 | 显示全部楼层
本帖最后由 ccc1122 于 2018-3-15 18:15 编辑

如果算上将AD 数据存储的时间,AD最高采用速率能达到多少?
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发表于 2018-3-14 20:23:54 | 显示全部楼层
lcdz00 发表于 2018-3-14 16:22
可不可 连接20M的高速AD 采集信号?

如果用IO翻转作为AD采样时钟,不知道同步性怎么样?原来用FMC的CLK作为采样时钟,FMC总线接AD数据口,对同一信号采样,发现两次的结果跳动很大,用示波器监测发现FMC的CLK信号实际上两次之间不完全同步。
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